発振器｜高安定な周波数源の方式と応用

2025.09.23

発振器

発振器は外部から周期関数を与えずに、電源と回路定数のみで自律的に正弦波・矩形波・鋸歯状波などの周期信号を生成する回路である。能動素子（オペアンプやトランジスタ）と周波数選択回路（RCやLC、共振子）を用い、帰還を適切に設計することで維持可能な振幅と周波数を得る。発振条件は起動（雑音や初期過渡）→成長（利得が1を超える区間）→振幅制限（非線形で利得が1に収束）という過程で満たされる。目的に応じて高安定・低位相雑音・広帯域可変などの指標が重視され、通信・計測・制御の中核となる。

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動作原理

発振器の基本は正帰還である。開ループ伝達関数をA、帰還網をβとすると、定常発振の条件はバークハウゼン条件 |Aβ|=1 かつ ∠Aβ=2πn である。起動時は|Aβ|>1として微小雑音を増幅し、振幅が成長すると能動素子の非線形で実効利得が低下して|Aβ|=1に落ち着く。周波数は周波数選択回路が位相を0°（もしくは360°）にする点で決まる。LC共振では f=1/(2π√(LC))、Wien橋では f=1/(2πRC) が代表式である。矩形波などの弛張発振は、充放電とスレッショルド判定（コンパレータ/シュミット）で周期を形成する。

種類

  • RC正弦波発振器：Wien橋、位相シフト。低～中周波域向け、部品が容易。

  • LC発振器：Colpitts/Hartley/Clapp。高Qで低位相雑音、RF帯で広く用いる。

  • 水晶発振器（XO/TCXO/OCXO）：圧電共振子で極めて高い周波数安定度を実現。温度制御でドリフトを抑制。

  • VCO：電圧制御型発振器。PLLの心臓部として周波数合成に用いる。

  • DDS/NCO：数値制御発振器。位相累算とDACで高分解能・迅速な周波数切替が可能。

  • 弛張発振器：RC充放電＋しきい値判定で矩形・三角波などを生成。タイマIC等で一般的。

主要パラメータ

  • 発振周波数・可変範囲：定格中心値とチューニング幅（VCO特性、DDSの周波数ワード）。

  • 周波数安定度：温度係数、長期ドリフト（aging）、電源感度（pushing）、負荷変動（pulling）。

  • 位相雑音：オフセット周波数に対するスペクトル密度。タイミングジッタと直結し通信・計測のSNRを左右。

  • 出力波形・レベル：正弦/方形、歪率、出力インピーダンス、ハーモニクス。

  • 起動条件：ループ利得余裕、Q、スタートアップ時間。

  • 消費電力・サイズ：携帯機器や高温環境での熱設計に関係。

設計の勘所と安定化

発振器の設計では、所望の周波数選択と利得・位相の管理が重要である。Wien橋では振幅制限にランプ抵抗やランプ電球、ダイオードによる非線形制御を用いて歪みを抑える。LCでは高Q素子、低損失基板、短い帰還経路で寄生成分を最小化する。位相雑音を抑えるには高Q共振子、低雑音能動素子、十分なバッファ隔離、クリーンな電源（LDO/フィルタ）を組み合わせる。水晶発振器では温度補償（TCXO）や恒温槽（OCXO）で周波数安定度を高める設計が一般的である。

測定と評価

  • 周波数・安定度：カウンタ、周波数基準に対するΔf/f測定、アラン分散評価。

  • 位相雑音：スペクトラムアナライザや位相雑音アナライザでL(f)を取得。

  • 波形品質：歪率、デューティ、立上り時間。プローブ容量で周波数が引かれないよう注意。

  • 負荷引き込み：出力にバッファを挿入し、負荷変動で発振器が引き込まれない設計と評価を行う。

応用

通信機の局部発振器やシンセサイザ、レーダのチャープ源、計測器のタイムベース、マイコンやFPGAのクロック源などに広く使われる。PLLと組み合わせたVCOは整数-N/分数-N方式で微細な周波数ステップと低ジッタを両立する。DDSは掃引や位相制御が容易で、任意波形発生器に応用される。電源系ではスイッチング発振器（PWM/自励）がコンバータの基本周期を形成する。

トラブルシューティング

  • 発振しない：ループ利得不足、位相条件未達、立上りバイアス不適切。能動素子の帯域・gm不足や温度条件も確認。

  • 周波数ずれ・飛び：温度・機械応力・電源リップル・負荷変動。水晶は実装ストレスで引込みが生じる。

  • 寄生発振器化：不要共振、帰還経路のクロストーク。レイアウトでグラウンド分割とシールドを徹底。

  • 位相雑音悪化：電源ノイズ、低Q、過剰利得。バッファ段を分離し、フィードバック定数を再最適化。

数式と設計指標

代表式として、LC共振 f=1/(2π√(LC))、Wien橋 f=1/(2πRC)、バークハウゼン |Aβ|=1・∠Aβ=2πn を挙げる。VCOの感度はKVCO=df/dV（Hz/V）で表し、PLLの出力ジッタは位相雑音とループ帯域のトレードオフで決まる。設計では、必要な周波数安定度（例：±0.5ppm）、位相雑音（例：1kHzオフセットで−120dBc/Hz）、スタートアップ時間、温度範囲、電源条件を要件化し、それに適した発振器方式と部品選定を行うのが実務的である。

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