ゲートチャージ
ゲートチャージとは、MOSFETやIGBTなどの電力半導体をオン・オフさせるために、ゲート端子へ出し入れする総電荷量Qgを指す。Qgはスイッチング速度、ゲートドライバ容量、ドライブ損失に直結する中核指標であり、設計ではQgs（しきい前チャージ）、Qgd（ミラー領域のチャージ）、残余区間の合計として理解する。データシートには一定のVds、Id、Vgs条件でのゲートチャージ曲線が示され、ミラー平坦部（ゲート電圧が一定でドレイン電圧が降下する区間）から動作動態を読み解く。
定義と分解：Qgs・Qgd・ミラー効果
Qgは主に三つの寄与で表される。QgsはVth到達までに必要な電荷で、チャネル形成の開始を支える。Qgdはミラー容量（Cgd）に起因し、ドレイン電圧が変化する間にゲートへ流入・流出する電荷で、スイッチング遷移の律速になることが多い。最後に、Vgsが最終ドライブ電圧へ上昇するための残余分がある。設計ではQgdの大きさがターンオン/オフの硬さやスイッチング損失、ノイズ余裕に強く影響する。
ドライブ損失と必要電流
ゲートはほぼ容量性負荷として振る舞うため、平均ゲートドライブ損失はおよそPdrive ≈ Qg×Vdrive×fsで見積もれる（fsはスイッチング周波数）。高周波化や大電流化ではこの損失が無視できず、ドライバICの熱設計や電源容量の見積りに直結する。必要な平均電流はIavg ≈ Qg×fs、ピーク電流は立上がり/立下り時間とゲート抵抗から決まる。急峻な駆動は損失を減らす一方でEMIやリンギングを増やすため、ゲート抵抗やスナバで妥協点を探る。
スイッチング損失との関係
ターンオン・オフの重なり損失は、ミラー領域の長さと電流・電圧の重なりで概ね決定される。Qgdが小さいほどミラー区間が短くなり、重なり損失が低減する傾向にある。逆にQgdが大きいデバイスは、ドレイン電圧が落ち切るまで時間を要し、ハードスイッチ時の損失が増える。したがって低損失設計では、Rds(on)やVce(sat)とQg（特にQgd）の両面から評価する「FOM（Figure Of Merit）」が有効である。
デバイス技術別の特徴
- Si MOSFET：世代進化でセル微細化とチャネル改良によりQg低減が進むが、耐圧上昇で一般にQgは増えやすい。
- SiC MOSFET：高速・高耐圧を実現しつつQgが小さく、特にQgdが小さいため高周波・高効率化に有利。
- GaN HEMT：ゲート構造に依存するが、総じて非常に小さいQgで超高速スイッチングが可能。ただしドライバ要件や寄生成分管理がシビアになる。
データシートの読み方
ゲートチャージ曲線は、横軸Qg、縦軸Vgsで描かれ、ミラー平坦部の長さがQgdに対応する。記載条件（Vds、Id、温度、Vgs範囲）に注意し、実機の動作点と合致しているか確認する。実測ではカレントプローブとゲート電圧波形からチャージ積分を推定し、条件差による乖離を把握する。なお温度上昇やVds条件の変化でCgdが変わり、見かけのQgdが増減することがある。
ドライバ設計の勘所
- 電源電圧とマージン：推奨Vgs（例：+10〜12 V）に対し、トランジェントでの落ち込みを見込む。
- 供給能力：Iavgとピーク電流の両方を満たすドライバを選ぶ。ブートストラップの場合はリフレッシュ余裕とESR損失を評価する。
- ゲート抵抗：立上がり調整とEMI低減のため、外付けRgを設計し、必要ならオン/オフ分離（Rg_on/Rg_off）を採用する。
- ミラー・クランプ：ミラー効果による意図しないターンオン（貫通）を防ぐため、ゲートソースクランプやアクティブミラークランプを用いる。
- レイアウト：ゲートループを最短・最小ループで配線し、帰路を近接させる。寄生成分（Lg、Cg）の低減が鍵である。
数値例と簡易計算
例えばQg=40 nC、Vdrive=10 V、fs=200 kHzのSiC MOSFETを考える。Pdrive ≈ 40e-9×10×200e3=0.08 Wとなり、ドライバ消費としては小さい。一方、Qg=160 nCで同条件なら0.32 Wまで増える。平均供給電流はそれぞれ8 mAと32 mAで、複数並列やハーフブリッジでは倍増に留意する。さらにQgdが20 nCから8 nCへ低減すれば、ハードスイッチ損失の顕著な低下が期待できる。
ハード/ソフトスイッチングとゲートチャージ
ハードスイッチングではQgdの影響が顕著で、Qg低減とドライブ強化が効率化に直結する。ZVSやZCSのソフトスイッチングでは、ミラー区間の電圧重なりが抑制され、同じゲートチャージでも損失影響が相対的に小さくなる。ただし共振回路やリークインダクタンス設計が前提で、ドライバは過度なリンギングを抑制する必要がある。
ミラーターンオンと貫通対策
ハーフブリッジで下側デバイスが高速ターンオンすると、上側のCgdを通じてゲートへ電荷が注入され、意図しないオン（ミラーターンオン）を招くことがある。対策として、ゲート・ソース間に低インピーダンスのクランプ、負のゲートバイアス、あるいはゲートドライバの強いシンク能力を用いる。これらはゲートチャージの流れを能動的に制御し、貫通電流を抑える。
FOM評価と部品選定
低Rds(on)かつ低Qg（特に低Qgd）のデバイスは高いFOMを示すが、寄生容量が小さすぎるとサージに脆くなる場合やdv/dt耐性が課題となる。アプリケーションに応じて、効率、EMI、コスト、制御性のバランスを取る。高周波PFCやLLCなどでは低Qg・低Qgdが有利で、同期整流側は逆回復の影響が小さいデバイスを選ぶとよい。
計測・評価の実践ポイント
- 波形取得：Vgs、Vds、Id、ゲート電流を同時観測し、ミラー区間の時間幅とチャージを推定する。
- 条件依存性：温度、バス電圧、負荷電流でQg（と見かけのQgd）は変動するため、代表点と最悪条件の両方を測る。
- モデル化：SPICEのCgs/Cgd/Cgd(v)依存を適切に設定し、過渡解析でスルーレートと過渡損失を検証する。
設計上の落とし穴
ドライバの電源インピーダンスが高いと、ゲート電圧が意図通りに立ち上がらず、結果的にゲートチャージの充放電が遅延し損失が増える。スルーレートを上げるためにRgを小さくし過ぎると、リンギングやEMIが増大する。スナバ、フェライトビーズ、デッドタイムの最適化で全体最適を図ることが重要である。
要点の整理
- ゲートチャージはスイッチングの速さとドライブ損失を決める核心指標。
- Qgdはミラー領域の長さを規定し、重なり損失と貫通リスクの主因。
- Pdrive ≈ Qg×Vdrive×fs、Iavg ≈ Qg×fsで粗見積もりが可能。
- SiCやGaNは低Qg・低Qgdで高周波・高効率に有利。ただし駆動はシビア。
- レイアウト、ゲート抵抗、ミラー対策が総合効率と信頼性を左右する。
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